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?集成電路可測(cè)性(DFT)設(shè)計(jì)工程師

集成電路可測(cè)性(DFT)設(shè)計(jì)工程師培訓(xùn)


集成電路可測(cè)性設(shè)計(jì)工程師》課程是工業(yè)和信息化部教育與考試中心組織開展的“工業(yè)和信息化職業(yè)技能提升工程”培訓(xùn)項(xiàng)目,旨在培養(yǎng)集成電路可測(cè)性設(shè)計(jì)(DFT)中級(jí)應(yīng)用型人才,提升一線企業(yè)工作人員的理論和動(dòng)手能力。


培訓(xùn)介紹

面向?qū)ο?/strong>

集成電路設(shè)計(jì)、制造、測(cè)試相關(guān)企業(yè)的專業(yè)人員能力提升、以及企業(yè)剛接收的應(yīng)屆研究生培訓(xùn)需求。

主辦單位

北方工業(yè)大學(xué)培訓(xùn)中心,高精尖創(chuàng)新研究院

協(xié)辦單位

廣東優(yōu)科檢測(cè)認(rèn)證有限公司

授課方式

線上直播授課


培訓(xùn)費(fèi)用

原價(jià)3500元,10人以上團(tuán)體或在校生八折優(yōu)惠


培訓(xùn)時(shí)間

培訓(xùn)時(shí)間:常年招生,具體開班時(shí)間請(qǐng)來(lái)電咨詢。

近期開班時(shí)間:2022年9月1日—9月5日


結(jié)業(yè)證書

由工業(yè)和信息化部教育與考試中心頒發(fā)《工業(yè)和信息化職業(yè)能力證書》,學(xué)員信息納入“工業(yè)和信息化技術(shù)技能人才庫(kù)”,可在官網(wǎng)(www.miiteec.org.cn)查詢。


集成電路可測(cè)性設(shè)計(jì)工程師培訓(xùn).jpg


課程內(nèi)容和安排(共計(jì)24學(xué)時(shí))

上課時(shí)間課程名稱涵蓋的知識(shí)點(diǎn)課時(shí)
第一天
19:30-21:00
集成電路測(cè)試技術(shù)概述測(cè)試技術(shù)在芯片中的作用,測(cè)試技術(shù)的分類,自動(dòng)測(cè)試設(shè)備ATE,測(cè)試技術(shù)面臨的挑戰(zhàn)和未來(lái)。2
第二天
19:00-22:10
數(shù)字集成電路測(cè)試方法集成電路測(cè)試意義及分類,數(shù)字邏輯電路與故障模型,組合邏輯電路測(cè)試,時(shí)序邏輯電路測(cè)試,可測(cè)性設(shè)計(jì)方法。4
第三天
14:00-17:10
邏輯電路可測(cè)性設(shè)計(jì)方法集成電路設(shè)計(jì)流程,邏輯電路的分類,Scan掃描電路技術(shù),ATPG自動(dòng)測(cè)試向量產(chǎn)生技術(shù)。4
第三天
19:00-22:10
邏輯電路可測(cè)性設(shè)計(jì)方法ATPG自動(dòng)測(cè)試向量產(chǎn)生壓縮技術(shù),LBIST邏輯自測(cè)試技術(shù),ATPG自動(dòng)測(cè)試向量產(chǎn)生IP Core,ATPG自動(dòng)測(cè)試向量產(chǎn)生和大規(guī)模集成電路先進(jìn)邏輯測(cè)試方法。4
第四天
14:00-17:10
Memory存儲(chǔ)器可測(cè)性設(shè)計(jì)方法Memory故障模型,Memory測(cè)試算法,Memory測(cè)試流程,Memory 自我修復(fù),Memory內(nèi)建自測(cè)試技術(shù)MBIST。4
第四天
19:00-21:15
Boundary Scan 邊界掃描電路技術(shù)與方法IEEE1149.1邊界掃描基礎(chǔ),IEEE 1149.1邊界掃描應(yīng)用, IEEE 1149.6邊界掃描應(yīng)用,IEEE 1687及應(yīng)用。3
第五天
19:00-19:45
Analog and Mixed Signal Test 模擬及混合信號(hào)電路測(cè)試模擬電路故障模擬,模擬電路故障模擬流程,DDR PHY測(cè)試實(shí)例。1
第五天
19:55-21:25
Diagnosis & Yield improvement ATE測(cè)試失效分析和良率改善芯片測(cè)試結(jié)果log分析,Diagnosis 失效診斷分析,Yield improvement 良率改善與分析。2
四天后 19:00-21:00考試


授課團(tuán)隊(duì)介紹

授課講師主要由來(lái)自北方工業(yè)大學(xué)及業(yè)界經(jīng)驗(yàn)豐富的資深測(cè)試應(yīng)用技術(shù)專家組成,均具有10年以上的集成電路測(cè)試教育培訓(xùn)及復(fù)雜芯片可測(cè)性設(shè)計(jì)應(yīng)用經(jīng)歷。對(duì)復(fù)雜芯片SOC如人工智能,汽車電子和GPU等可測(cè)性設(shè)計(jì),積累了實(shí)際的技術(shù)經(jīng)驗(yàn)。在邏輯電路可測(cè)性設(shè)計(jì)、存儲(chǔ)器可測(cè)性設(shè)計(jì)、邊界掃描技術(shù)、內(nèi)建自測(cè)試技術(shù)設(shè)計(jì)方面,全面掌握當(dāng)前芯片測(cè)試設(shè)計(jì)的需求和工程測(cè)試設(shè)計(jì)規(guī)劃的制定。對(duì)主流可測(cè)性設(shè)計(jì)軟件的項(xiàng)目開發(fā)與應(yīng)用方面具有豐厚的理論和實(shí)踐積淀。


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